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EMC中ESD靜電整改解決方案(下)

文章出處:行業(yè)動(dòng)態(tài) 責(zé)任編輯:遞百科 發(fā)表時(shí)間:2020-05-25

3.敏感器件電源添加LC濾波

有些IC特別容易受靜電影響,進(jìn)行ESD試驗(yàn)時(shí),總是發(fā)生復(fù)位或者死掉。究其原因,一般都是電源引腳受到干擾。對(duì)此可以對(duì)其電源添加LC濾波。一般芯片的VDD管腳旁邊都會(huì)有一個(gè)去耦電容,但是這個(gè)去耦電容是沒有辦法有效攔截靜電的,甚至是幾十uF的鉭電容并接小電容,作用仍舊不佳。這時(shí)候,如果再串一個(gè)小電感,情況就得到很好的改觀。靜電放電會(huì)產(chǎn)生一個(gè)尖峰,同屬于高頻干擾,LC可以很好地將高頻濾除,使通過電感之后的尖峰大大減弱,IC就不容易死機(jī)或者復(fù)位。

4.PCB鋪地要求

PCB要盡可能多的鋪地。如果是雙面板,兩面都要大面積鋪銅,而且還要有足夠的地過孔;如果是四層板或以上,主要元件層的臨近平面層要設(shè)置成地層。
比如四層板,如果主要元件在頂層,那么分層為:頂層->地層->電源層->底層;
如果主要元件在底層,分層為:頂層->電源層->地層->底層。

5.接地要求

靜電要得到有效釋放,就要保證良好的接地。對(duì)于醫(yī)療電子,一般的醫(yī)療電子產(chǎn)品比如監(jiān)護(hù)儀,機(jī)身后面都會(huì)有一個(gè)等電位接地端。在做ESD試驗(yàn)的時(shí)候,這個(gè)接地端也是要接大地的,這樣就有了一個(gè)靜電快速泄放的途徑。

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